一种流水线adc数字域增益校准方法
阅读说明：本技术 一种流水线adc数字域增益校准方法 (Pipeline ADC digital domain gain calibration method ) 是由 苗澎 王欢 黎飞 杨迎 于 2020-12-16 设计创作，主要内容包括：本发明提供了一种流水线ADC数字域增益校准方法,该方法由流水线高级向低级依次校准,每一级校准首先将该级流水级的输入(Vin)从低到高依次选通所有比较器的阈值电平,每一次选通期间,使用数据选择器将阈值电平对应的两个相邻数字码作为DAC的输入,在DAC输入两种不同数字码的情况下比较该级和后级的总数字输出即可得到理想增益和实际增益的误差。再将所有选通期间的误差送入累加器,得到需要校正的误差平均值,最终通过可编程反馈电容的方式来调整MDAC电路的级间增益,从而减小。本发明针对流水线的极间增益误差,实现了使用数字域判断平均增益误差的功能。采用带可编程反馈电容阵列的开关电容电路,实现了减小平均增益误差的功能。(The invention provides a method for calibrating the gain of a pipeline ADC digital domain, which is characterized in that the high level of a pipeline is calibrated to the low level in sequence, the input (Vin) of the pipeline stage of each stage is firstly gated by the threshold level of all comparators from low to high in sequence in each stage of calibration, during each gating period, a data selector is used for taking two adjacent digital codes corresponding to the threshold level as the input of a DAC, and the errors of ideal gain and actual gain can be obtained by comparing the total digital output of the stage and the later stage under the condition that the DAC inputs two different digital codes. And then all errors in the gating period are sent to an accumulator to obtain an error average value to be corrected, and finally, the interstage gain of the MDAC circuit is adjusted in a programmable feedback capacitor mode, so that the error average value is reduced. The invention aims at the interelectrode gain error of the production line and realizes the function of judging the average gain error by using a digital domain. The function of reducing average gain error is realized by adopting a switched capacitor circuit with a programmable feedback capacitor array.)
技术领域
本发明涉及一种流水线ADC数字域增益校准方法，主要用于对流水线级间增益放大器的平均增益误差进行校准，属于混合信号集成电路技术领域。
背景技术
如图1所示为流水线ADC的系统框图，流水线ADC由N级的低精度子级量化器，时钟产生电路和数字逻辑电路组成。流水线ADC的子级包括sub-ADC，sub-DAC和一个残差放大器，完成的功能包括量化、减法和残差放大，后两种功能在实际电路设计中一般集成在一个模块，即MDAC模块。
流水线ADC非理想误差，包括电容失配、非理想运放、比较器失调，采样误差以及热噪声、电荷注入、时钟抖动和时钟馈通等误差。其中电容失配，非理想运放都会导致极间增益放大器的增益出现误差，并且极间增益误差是限制流水线ADC精度最主要的因素。
如图2所示为流水线的极间增益放大器电路示意图。放大器采用带可编程反馈电容阵列的开关电容电路，假设运算放大器增益为A，则G表达式为公式1；βc表达式为公式2。
可以看到只要通过编程控制开关闭合反馈电容C1-Cn就可以调整MDAC电路的极间增益。
MDAC的增益误差和输入信号幅度有关，其传递函数被比较器划分为多段折线，每一段折线对应的输入信号幅度不同，这些折线的增益误差也有细微的区别，比如一些可能大于理想增益误差，另一些小于理想增益误差。
若以某一段折线作为检测基础，可能该折线的校准效果理想，但其他折线的增益会进一步恶化，不利于最终的系统性能。
发明内容
本发明要解决的技术问题是提供一种流水线ADC数字域增益校准方法，针对流水线的极间增益误差，实现了使用数字域判断平均增益误差的功能。采用带可编程反馈电容阵列的开关电容电路，实现了减小平均增益误差的功能。
本发明解决上述技术问题的技术方案主要包括：
一种流水线ADC数字域增益校准方法，主要包括以下步骤：
(1)要实现误差的校准，首先要测得产生的误差的大小，增益误差数字域测量是利用流水线ADC分级量化的原理实现的，其实现的基本原理如图3所示。
(2)增益误差测量时，流水线ADC的输入(Vin)接固定电位，在电路上可以通过接子ADC的阈值电压实现。
(3)使用数据选择器(MUX)选择步骤(2)中的阈值电压对应的两种数字码Dstep1和Dstep2作为当前流水级的数字输出和DAC的输入。
(4)根据量化原理，步骤(3)中作为DAC输入的两种数字码Dstep1和Dstep2将对应两种不同的后级数字码输出Dbackend1和Dbackend2，并利用以下公式来确定
Dbackend1和Dbackend2的值。
其中Vout1和Vout2分别为DAC输入的两种数字码Dstep1和Dstep2时对应的该级输出，Vref为参考电压，m为后级ADC级数，Gactual为实际增益值，Vin为输入的该级ADC的阈值电压，V比较器1和V比较器2分别为Vin取阈值电压时对应的两种比较器电压。
(5)两种数字码Dstep1和Dstep2将得到两种该级和后级的总数字输出Dout1和Dout2，用以下公式来确定Dout1和Dout2的值。
其中m为后级ADC级数，n为本级ADC级数，Gtheory为理想增益。
(6)两个阶段的数字码相减可以得到以下公式：
(7)利用Dout1和Dout2的差值就可以得到Gtheory和Gactual的大小关系。
(8)重复步骤(2)-(7)，依次选通所有阈值电压作为Vin，所有判断结束后将总的误差送入校准环节，经过重复检测和累加，检测环节实际输出的是待校准流水线级各段折线增益误差的平均值，需要校正的也是误差的平均值，校正结果获得了全局最优解。
在实际应用中，级间增益误差校准过程如下：
若Dout1>Dout2，即实际极间增益大于理想极间增益，通过增加开关闭合个数可以减小实际增益值。
若Dout1<Dout2，即实际极间增益小于理想极间增益，通过减小开关闭合个数可以增加实际增益值。
若Dout1＝Dout2，即实际极间增益等于理想极间增益，校准结束。
有益效果：本发明针对流水线的极间增益误差，不必求出具体的极间增益值，而是使用数字域判断实际极间增益值和理想极间增益值的大小从而进行自动调整。校准方法将所有折线对应的增益误差累加求平均值，经过重复检测和累加，检测环节的实际输出是待校准流水线各段折线增益误差的平均值，需要校正的也是误差的平均值，以牺牲局部最优解为代价换取了全局最优解。本发明针对流水线的极间增益误差，实现了使用数字域判断平均增益误差的功能。采用带可编程反馈电容阵列的开关电容电路，实现了减小平均增益误差的功能。
附图说明
图1是根据本发明的流水线ADC的系统框图；
图2是根据本发明的流水线极间增益放大器电路示意图；
图3是根据本发明的增益误差在数字域测量原理框图；
图4是根据本发明的带可编程反馈电容阵列的开关电容电路；
图5是一个本级ADC3bit，增益为4，后级ADC3bit的流水线转换特性图。
具体实施方式
下面将结合附图和具体实施例对根据本发明的一种流水线ADC数字域增益校准方法做进一步说明。
为了使本发明的技术方案与优势更加容易理解，以下结合实例和附图做进一步说明。在此本发明的示意性实例用于解释和说明，但不作为本发明的限定。
根据数字测量过程中两个阶段的数字输出码大小来判断增益是否满足要求，本发明提出了如图4所示的一种可编程反馈电容的方式来实现电容比例的调整从而校准实际增益值。
如图4所示，该电路提供了7-bit电容阵列来调节反馈电容大小，根据电荷守恒有以下公式：
Vout＝-AVx
根据上式可得到增益G为以下公式：
如图5所示是一个本级ADC3bit，理想增益为4，后级ADC3bit的流水线转换特性图，我们将以这种方式为例对本发明的一种流水线ADC数字域增益校准方法进行阐述。
具体实施方案如下：
依次选通阈值电压-5/8Vref，-3/8Vref，-1/8Vref，1/8Vref，3/8Vref，5/8Vref作为本级的输入Vin。
在每个阈值电压的选通期间，使用数据选择器(MUX)选择阈值电压对应的两种数字码Dstep1和Dstep2作为当前流水级的输出和DAC的输入。
下面选择1/8Vref作为本级的输入Vin进行后续的详细分析，阈值电压1/8Vref对应的两种数字码为011和100。
当DAC的输入为011时，Dbackend1如公式(3)所示：
此时整体ADC的数字输出(假设前级数字输出为0)如公式(4)所示：
Dout1＝GtheoryDstep1+Dbackend1 (4)
当DAC的输入为100时，Dbackend1如公式(5)所示：
此时整体ADC的数字输出(假设前级数字输出为0)如公式(6)所示：
Dout2＝GtheoryDstep2+Dbackend2 (6)
两个阶段的数字码相减可以得到公式(7)：
Dout1-Dout2＝Gactual-Gtheory (7)
通过比较Dout1和Dout2的大小就可以得到Gactual和Gtheory的关系。
下面通过举例进行具体分析：
(1)固定输入Vin＝1/8Vref，根据传输曲线图5所示。
Dstep1＝011时，下一级的模拟输入Vin＝1/2·Vref，下一级的3bit FLASH量化编码输出为Dbackend1＝101，此时ADC总的数字输出为Dout1＝10001。
Dstep2＝100时，下一级的模拟输入Vin＝-1/2·Vref，下一级的3bit FLASH量化编码输出为Dbackend2＝001，此时ADC总的数字输出为Dout2＝10001。
所以极间增益为理想增益4时，Dout1＝Dout2。
(2)固定输入Vin＝1/8Vref，Dstep1＝011时，若级间增益大于理论值4，下一级的模拟输入Vin>1/2·Vref，下一级的3bit FLASH量化编码输出为Dbackend1＝110，此时ADC总的数字输出为Dout1＝10010。
Dstep2＝100时，此时ADC总的数字输出不变，为Dout2＝10001。
所以极间增益大于理想增益4时，Dout1>Dout2。
(3)固定输入Vin＝1/8Vref，Dstep1＝011时，若级间增益小于理论值4，此时ADC总的数字输出不变，为Dout1＝10001。
Dstep2＝100时，下一级的模拟输入Vin<-1/2·Vref，下一级的3bit FLASH量化编码输出为Dbackend2＝010，此时ADC总的数字输出为Dout1＝10010。
所以极间增益小于理想增益4时，Dout1<Dout2。
依次选通阈值电压-5/8Vref，-3/8Vref，-1/8Vref，1/8Vref，3/8Vref，5/8Vref作为本级的输入Vin。
将6次判断的后的总误差送入校准环节，检测环节实际检测的是待校准流水级各级折线的增益误差的平均值，获得增益校准的全局最优解。
接下来使用如图4所示的7bit可编程反馈电容开关电容电路进行平均增益误差的校准。
其增益G为以下公式：
若6次判断中Dout1>Dout2的次数多，即实际极间增益平均值大于理想极间增益，通过增加开关闭合个数可以减小实际增益值。
若6次判断中Dout1<Dout2的次数多，即实际极间增益平均值小于理想极间增益，通过减小开关闭合个数可以增加实际增益值。
若Dout1>Dout2的次数等于Dout1<Dout2的次数，即实际极间增益平均值等于理想极间增益。
以上所述，仅是本发明的较佳实施例，并非对本发明做任何形式上的限制，凡是依据本发明的技术实质对以上实施例所作的任何简单修改、等同变化，均落入本发明的保护范围之内。
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