阅读说明：本技术 一种宽带低杂散锁相环电路 (broadband low stray phase-locked loop circuit ) 是由 高翔 罗鲍 金高锋 于 2019-09-29 设计创作，主要内容包括：本发明公开一种宽带低杂散锁相环电路,其包括多相信号产生模块、鉴相模块、压控振荡器和分频模块,参考信号从多相信号产生模块输入,输出多相信号进入鉴相模块,鉴相模块将多相信号产生模块的输出的多路参考信号和分频模块的输出的多相时钟信号进行鉴相,输出多路信号调整压控振荡器的振荡频率,压控振荡器输出振荡信号到分频模块,分频模块输出的时钟信号到鉴相模块；多相信号产生模块输出的多路参考信号和分频模块的输出的多相时钟信号的相位一一对应。本发明通过多路控制电压控制压控振荡器,使多路控制电压的周期性纹波进行叠加,从而提高总控制电压的周期性纹波的频率,利用环路特性,对其进行抑制,从而抑制了输出杂散。(The invention discloses broadband low-spurious phase-locked loop circuits, which comprise a multi-phase signal generating module, a phase discrimination module, a voltage-controlled oscillator and a frequency division module, wherein a reference signal is input from the multi-phase signal generating module, the output multi-phase signal enters the phase discrimination module, the phase discrimination module carries out phase discrimination on a multi-path reference signal output by the multi-phase signal generating module and a multi-phase clock signal output by the frequency division module, the multi-path signal is output to adjust the oscillation frequency of the voltage-controlled oscillator, the voltage-controlled oscillator outputs an oscillation signal to the frequency division module, the clock signal output by the frequency division module is output to the phase discrimination module, the multi-path reference signal output by the multi-phase signal generating module corresponds to the phase of the multi-phase clock signal output by the frequency division module.)

一种宽带低杂散锁相环电路

技术领域

本发明涉及到射频集成电路中频率的产生和综合领域，具体涉及一种宽带低杂散锁相环电路。

背景技术

锁相环是现代通信系统芯片里面不可缺少的关键模块，基于锁相环结构的扩展应用，我们可以得到较为精准的时钟频率信号，因此锁相环广泛应用于信号接收发送，数据恢复，芯片时钟产生，接口电路等。同时随着SOC技术的推广与应用和集成电路工艺的进步，电路集成度的越来越高，越来越多的功能模块被集成到一块芯片上，对单个电路功能模块的面积要求越来越小。这些都促使着我们对锁相环电路进行更加深入的研究，以满足产品功能需求。

对于传统的锁相环结构，如图1所示，主要是采用D触发器结构的鉴频鉴相器对输入的参考信号和经由分频器的反馈信号进行比较，之后经由电荷泵和环路滤波器产生控制电压对压控振荡器进行控制，想要实现输出信号较低的杂散，则需要降低锁相环的环路带宽，来抑制杂散，常用截止频率较低的环路滤波器对控制信号上的纹波进行滤除，这样做的话，一方面需要较大的滤波电容，另一方面就限制了锁相环带宽的提高。同时，由于LC振荡器使用到了电感器件，占用了较大的面积资源，同时电感更易和其他电路产生耦合，环形振荡器相较LC振荡器面积更小，能够实现更宽的谐振范围，但是其相位噪声特性更差，因此在利用环形振荡器的优点时，为了得到更好的锁相环整体性能，还需要对系统结构进行优化，锁相环有大的环路带宽可以改善环形振荡器的相位噪声，但是又不可避免的使得输出杂散过大。

发明内容

针对现有技术的不足，本发明提供一种宽带低杂散锁相环电路，该电路能够在有效的抑制输出杂散的情况下，得到较大的锁相环带宽。

一种宽带低杂散锁相环电路，其特征在于，其包括多相信号产生模块、鉴相模块、压控振荡器和分频模块，参考信号从多相信号产生模块输入，输出多相信号进入鉴相模块，鉴相模块将多相信号产生模块的输出的多路参考信号和分频模块的输出的多相时钟信号进行鉴相，输出多路信号调整压控振荡器的振荡频率，压控振荡器输出振荡信号到分频模块，分频模块输出的时钟信号到鉴相模块；

所述的多相信号产生模块输出的多路参考信号和分频模块的输出的多相时钟信号的相位一一对应。

进一步地，多相信号产生模块的输出的多路参考信号的振荡频率相同，等于输入的参考信号频率。

进一步地，所述的鉴相模块为采样型鉴相模块。

进一步地，所述的压控振荡器具有多个控制端口，每个控制端口的压控增益相同。

进一步地，所述的分频模块输出的时钟信号的占空比可调。

进一步地，所述的压控振荡器为环形振荡器或LC振荡器。

本发明的有益效果如下：

本发明的宽带低杂散锁相环电路通过多路控制电压控制压控振荡器，使多路控制电压的周期性纹波进行叠加，从而提高总控制电压的周期性纹波的频率，利用环路特性，对其进行抑制，从而抑制了输出杂散，提高了锁相环系统的快速调优能力、稳定性和输出信号的频谱纯度。

附图说明

图1为传统I型结构锁相环结构示意图；

图2为本发明的宽带低杂散锁相环电路的结构示意图；

图3为本发明多路信号产生模块结构的原理示意图；

图4为多路控制信号输入环形压控振荡器的原理示意图；

图5为采用一路亚采样鉴相器锁相环的杂散仿真结果图；

图6为采用四路理想相位差参考信号、四路亚采样鉴相器锁相环的杂散仿真结果图。

具体实施方式

下面根据附图和优选实施例详细描述本发明，本发明的目的和效果将变得更加明白，应当理解，此处所描述的具体实施例仅仅用以解释本发明，并不用于限定本发明。

如图2所示，本发明的宽带低杂散锁相环电路包括多相信号产生模块、鉴相模块、压控振荡器和分频模块；

多相信号产生模块，利用输入的参考信号产生系统所需的多路多相位信号；所述的多相信号产生模块输出的多路参考信号和分频模块的输出的多相时钟信号的相位一一对应。如图3所示；

鉴相模块，用来比较多相信号产生模块的输出和分频信号的相位差异，输出鉴相结果；

压控振荡器，能够适应多路控制信号输入，输出振荡频率，如图4所示；

分频器模块，对压控振荡器的单路输出信号进行分频，并且能够输出多相位信号。产生的多相分频信号反馈回鉴相模块，对系统进行反馈调节。

该系统结构相较于传统的I型锁相环，能够实现压控振荡器总控制信号的低纹波，在大带宽条件下实现低杂散，并且对多相信号产生模块产生的信号的非理想特性不敏感。从而，该结构提高了锁相环系统的快速调优能力、稳定性和输出信号的频谱纯度。

作为其中一种实施方式，多相信号产生模块具体为四路相邻正交信号产生电路，其由电容和电阻串联并联组成，电容值和电阻值的偏差对电路输出信号的影响有导致四路输出信号幅值大小改变和四路输出信号的相位间隔改变两种情况。四路输出信号的频率和该模块输入的差分参考频率大小相同。

作为其中一种实施方式，四路相邻正交信号产生电路的输入为一差分正弦波形式的参考信号，经由该模块产生相位依次等间隔的四路信号。

四路相邻正交信号产生电路的差分输入有两种输入方式，一种是差分信号每一路信号接入口连接一对电容和和电阻，另一种是差分信号每一路接入口连接两对电容和电阻。

四路相邻正交信号产生电路具备多级级联能力，将上一级的输出作为下一级的输入即可实现级联。

作为其中一种实施方式，所述的四路信号产生电路，可以由开关切换成两种模式。这两种模式的区别在于，当电路参数受到PVT变化偏离理想设定值的时候，一种模式特征为：输出的四路信号相位间隔不变，仍为90度，信号的幅值会有偏差。另一种模式的特征为：输出的四路信号相位间隔会有一定偏差，输出信号的幅值仍保持相同。在采用其他路数的实施例中，多相信号产生电路可能会有变化，但是其输出信号特征和在系统中的作用保持不变。

作为其中一种实施方式，鉴相模块为四路采样鉴相结构，设有四个鉴相通路，每个通路由两个反向的采样时钟控制，实现对被采样信号的采样保持。在此实施例中，分别输入多路的参考信号和多路的分频信号，两种不同产生源输入信号均可根据该系统结构需要作为被采样信号或者采样时钟，采样输出得到多路电压信号。鉴相得到的多路信号经过滤波之后连接多路环形压控振荡器，同时作用于压控端，实现对压控振荡器频率调节的作用，并且有效降低输出的杂散。

作为其中一种实施方式，所述的环形压控振荡器具备适应多通道输入特点，每一路对应有独立的压控电容，输出信号为单路信号。输出信号的频率可由输入控制信号电压和环形振荡器供电电压进行调节。

作为其中一种实施方式，所述分频模块对输入单路信号进行分频，输出分频后四路相邻正交的方波信号。

如图5所示，给出了采用一路亚采样鉴相器锁相环的杂散仿真结果，参考杂散约为-41.9dBc，图6是采用本发明的四路理想相位差参考信号、四路亚采样鉴相器锁相环的杂散仿真结果，参考杂散约为-93.6dBc。表1也给出了具体的两个仿真结果的对比数据，从中可以看出，相对于一路亚采样锁相环有了-51dB的杂散性能提升，从而证明本发明提出的宽带低杂散锁相环电路有很好杂散性能。

表1采用一路亚采样鉴相器锁相环和本发明的电路的杂散仿真结果对比表

	0	50MHz	200MHz	杂散
					一路	-6.02dB	-47.92dB	-98.92dB	-41.9dBc
四路	-6.02dB	-114.07dB	-99.66dB	-93.64dBc
									51.74dB

在本发明申请书的描述中，“多路”指的是两路及其以上的数量，实施例中提到的“四路”也是包含在“多路”的范畴之内，“四路”的表述指的是在一个实施例中，用以具体的介绍本发明的系统结构。换言之，将具体实施例“四路”变化成其他多路仍然符合本发明的系统结构。即本实施例所提到的通过四路采样结构来实现宽频低杂散方法同样适用于其他多路的结构，尽管上面已经出示和描述了本发明的实施例，但此实施例是为示范性说明使用，不能当做是对本发明的限制，本领域的相关技术人员在本发明所提出的锁相环结构类型框架下可以对上述实施例做出简单的替换，推演，变型等工作。皆认为在本专利的保护范围之内。