阅读说明：本技术 降低芯片逻辑翻转率的方法及结构 (Method and structure for reducing chip logic turnover rate ) 是由 何文俊 郭凯 于 2019-08-19 设计创作，主要内容包括：发明提供了一种降低芯片逻辑翻转率的方法及结构,N个寄存器中存储的数据不参与到传递过程中多级寄存器的翻转,N为大于等于1的自然数,而是当所述反向标识的值为预设标识的值时,直接将N个寄存器中存储的数据与N位初始信号进行异或运算,从而得到预期信号,整体上有效的降低了逻辑翻转率,从而降低了系统功耗。(The invention provides a method and a structure for reducing the logic turnover rate of a chip, wherein data stored in N registers does not participate in the turnover of a multi-stage register in the transmission process, N is a natural number which is more than or equal to 1, and when the value of a reverse identifier is the value of a preset identifier, the data stored in the N registers and an N-bit initial signal are directly subjected to XOR operation to obtain an expected signal, so that the logic turnover rate is effectively reduced on the whole, and the power consumption of a system is reduced.)

降低芯片逻辑翻转率的方法及结构

技术领域

本发明属于集成电路芯片设计领域，涉及一种降低芯片逻辑翻转率的方法及结构。

背景技术

在芯片设计中，所有逻辑翻转都会逐级往后传递；造成了系统逻辑翻转率较高，中间级的部分翻转没有负载使用，为了最后能得到正确输出，一直在空翻，导致动态功耗的浪费；而如果设计需求中间级寄存器过多，则系统动态功耗将成倍增加。

而很多产品对核心芯片功耗的要求非常严格，功耗偏大不但会造成芯片耗电加速，折旧加速，也会带来发热，芯片散热成本升高等等问题；对于移动端产品，功耗也是最重要的性能指标之一；而现有的技术方案对于流水结构中多比特信号的冗余翻转部分未做处理，在设计上对功耗的考虑欠优化。

基于此，亟需一种降低芯片逻辑翻转率的方法及结构，以降低系统动态功耗。

发明内容

参照图1，图1为未做降低逻辑翻转率处理的电路示意图。图中以4位低电平信号翻转成4位高电平信号，然后传递M级寄存器流水，最后送到负载端进行使用。其中M为大于1的自然数。从图1中可以看出，如此设计造成了逻辑过早进行翻转和中间级寄存器流水的逐级传递翻转率。4位初始信号为0000，与其对应的预期信号为1111，即由0000翻转为1111，翻转率为100％，需要翻转4次，假设传递4级寄存器(实际情况中会有更多级)之后使用，那么整体的翻转次数为20次。

本发明的目的是为了提供一在满足芯片设计功能的前提下，从芯片设计角度降低多位信号逻辑翻转率，从而降低芯片动态功耗的方法及结构。

本发明提供了一种降低芯片逻辑翻转率的方法，用于降低芯片中信号的逻辑翻转率，包括：

获取N位初始信号和所述初始信号的N位预期信号；

针对所述N位初始信号中的第i位初始信号，执行以下步骤：

将反向标识的值记为预设标识值，并将第i位初始信号和第i位预期信号的异或结果存储于第i个寄存器中；

当需要所述N位初始信号时，根据所述第i个寄存器中存储的数据和第i位初始信号，获取所述第i位预期信号；

其中，N和i为大于等于1的自然数。

优选的，在上述的降低芯片逻辑翻转率的方法中，当翻转率大于等于预设翻转率时，将所述反向标识的值记为所述预设标识值。

优选的，在上述的降低芯片逻辑翻转率的方法中，将N个寄存器中的异或结果求和，当所得和值大于等于(1/预设翻转率)时，翻转率大于等于所述预设翻转率。

优选的，在上述的降低芯片逻辑翻转率的方法中，所述预设标识值为1或0。

本发明还提供了一种降低芯片逻辑翻转率的结构，用于降低芯片中N位信号的逻辑翻转率，包括：N个异或门、至少一个加法器、N个寄存器；

针对N位信号中的第i位初始信号，分别执行以下操作：

将第i位初始信号和与其对应的第i位预期信号输入第i个异或门，获得第i个异或结果，并将所述第i个异或结果存储于第i个寄存器；

将N个异或结果输入所述至少一个加法器，获得异或结果和值；

其中，N和i均为大于等于1的自然数。

优选的，在上述的降低芯片逻辑翻转率的结构中，还包括异或求和寄存器，用于存储所述异或结果和值。

优选的，在上述的降低芯片逻辑翻转率的结构中，还包括反向标识寄存器，用于存储反向标识的值。

本发明提供了一种降低芯片逻辑翻转率的方法及结构，N个寄存器中存储的数据不参与到传递过程中多级寄存器的翻转，N为大于等于1的自然数，而是当所述反向标识的值为预设标识的值时，直接将N个寄存器中存储的数据与N位初始信号进行异或运算，从而得到预期信号，整体上有效的降低了逻辑翻转率，从而降低了系统功耗。

附图说明

图1为未做降低逻辑翻转率处理的电路示意图；

图2为本发明一实施例中降低芯片逻辑翻转率的方法的流程图；

图3为本发明说明书中一实施例中降低芯片逻辑翻转率的结构的示意图；

图4为本发明说明书中一个4位初始信号翻转率降低的示意图。

具体实施方式

在以下的叙述中，为了使读者更好地理解本发明而提出了许多技术细节。但是，本领域的普通技术人员可以理解，即使没有这些技术细节和基于以下各实施方式的种种变化和修改，也可以实现本发明各权利要求所要求保护的技术方案。

为使本发明的目的、技术方案和优点更加清楚，下面将结合附图对本发明的实施方式作进一步地详细描述。

本发明实施例提供了一种降低芯片逻辑翻转率的方法，用于降低芯片中信号的逻辑翻转率，具体的，如图2所示，图2为本发明一实施例中降低芯片逻辑翻转率的方法的流程图，包括以下步骤：获取N位初始信号和所述初始信号的N位预期信号，如图2中的步骤S202；针对所述N位初始信号中的第i位初始信号，将反向标识的值记为预设标识值，并将第i位初始信号和第i位预期信号的异或结果存储于第i个寄存器中，如图2中的步骤S204；以及当需要所述N位初始信号时，根据所述第i个寄存器中存储的数据和第i位初始信号，获取所述第i位预期信号，如图2中的步骤S206，其中，N和i为大于等于1的自然数。

具体的，当翻转率大于等于预设翻转率时，将所述反向标识的值记为所述预设标识值。在本发明说明书的一个实施例中，所述预设标识值为50％，当然在本发明的其他实施例中，所述预设标识值还可以是0到1之间的任意其他值，例如为25％等。根据工程师的习惯或者项目工程的需求，所述预设标识值可以是标记为0，也可以标记为1，在此对此并不多加限制。

进一步的，将N个寄存器中的异或结果求和，当所得和值大于等于(1/预设翻转率)时，当前芯片的逻辑翻转率大于等于所述预设翻转率。

本发明又一实施例还提供了一种降低芯片逻辑翻转率的结构，用于降低芯片中N位信号的逻辑翻转率，其中，N为大于等于1的自然数，如图3所示，图3为本发明说明书中一实施例中降低芯片逻辑翻转率的结构的示意图，包括：N个异或门、至少一个加法器、N个寄存器以及异或求和寄存器。针对N位信号中的第i位初始信号，分别执行以下步骤：首先，将第i位初始信号和与其对应的第i位与其信号输入第i个异或门，获得第i个异或结果，并将所述第i个异或结果存储于第i个寄存器，其中，i为大于等于1的自然数；将N个异或结果输入所述至少一个加法器，获得异或结果和值，并将所述异或结果和值存储于所述异或求和寄存器中。

进一步的，所述降低芯片逻辑翻转率的结构还包括反向标识寄存器，用于存储反向标识的值。具体的，本发明说明书中的一个实施例中，当翻转率大于等于预设翻转率时，将所述反向标识的值记为所述预设标识值。

更进一步的，将N个寄存器中的异或结果求和，当所得和值大于等于(1/预设翻转率)时，翻转率大于等于所述预设翻转率。

以下以一个具体的例子来进行说明。如图4所示，图4为本发明说明书中一个4位初始信号翻转率降低的示意图。4位初始信号为0000，与其对应的预期信号为1111，即由0000翻转为1111，预设翻转率为50％，采用4个异或门，一个4比特加法器来判断，此时，4个异或结果全为1，翻转率为100％，大于预设翻转率50％，将反向标识的值设为1，用4个寄存器来存储异或结果，此处4bit数据不翻转，传递4级寄存器的过程中也不翻转，直至负载端需要用这4bit初始信号参与逻辑运算。

此时，先识别所述反向标识的值，此时，所述反向标识的值为1，则取出4个寄存器中的存储的异或结果(0000)，和翻转前的4bit初始信号(即0000)进行异或运算，得到1111，即为预期信号。

在上述的过程中，虽然新增了N个寄存器，但是省去了中间4级寄存器流水的多比特逻辑空翻，整体上可以有效降低逻辑翻转率，从而降低系统功耗。

在本发明提供的一种降低芯片逻辑翻转率的方法及结构中，N个寄存器中存储的数据不参与到传递过程中多级寄存器的翻转，N为大于等于1的自然数，而是当所述反向标识的值为预设标识的值时，直接将N个寄存器中存储的数据与N位初始信号进行异或运算，从而得到预期信号，整体上有效的降低了逻辑翻转率，从而降低了系统功耗。

对本领域的技术人员来说，可根据以上描述的技术方案以及构思，做出其它各种相应的改变以及形变，而所有的这些改变以及形变都应该属于本发明权利要求的保护范围之内。