具体实施方式

以下通过特定的具体实例说明本发明的实施方式，本领域技术人员可由本说明书所揭露的内容轻易地了解本发明的其他优点与功效。本发明还可以通过另外不同的具体实施方式加以实施或应用，本说明书中的各项细节也可以基于不同观点与应用，在没有背离本发明的精神下进行各种修饰或改变。

请参阅图1。需要说明的是，本实施例中所提供的图示仅以示意方式说明本发明的基本构想，遂图式中仅显示与本发明中有关的组件而非按照实际实施时的组件数目、形状及尺寸绘制，其实际实施时各组件的型态、数量及比例可为一种随意的改变，且其组件布局型态也可能更为复杂。

如图1所示，本发明提供一种超导集成电路的布局方法，所述超导集成电路的布局方法至少包括：

步骤S1：基于标准单元库建立以器件管脚为数据主体的数据库，所述数据库包括时序及物理信息。

具体地，基于标准单元库获取单元的时序及物理模型，以此建立以器件管脚为数据主体的数据库。所述数据库包括器件管脚的时序及物理信息，所述物理信息包括但不限于器件尺寸及管脚位置，任意管脚的物理信息均适用于本发明。

步骤S2：基于所述数据库进行静态时序分析，得到每个管脚的时序信息。

具体地，根据所述数据库中的信息进行基于版图的静态时序分析，包括基于电路的连接情况计算每条时序路径的时序裕量，以此得到各管脚的时序信息。

步骤S3：基于各管脚的时序信息及器件的逻辑深度确定各管脚的优先级，对优先级高的管脚进行直连，以构造初始布局结果。

具体地，管脚的时序裕量越小对应的时序控制越难(即时序紧张)，因此需要基于时序裕量确定管脚的优先级；管脚的时序裕量越小，对应管脚的优先级越高。而器件的逻辑深度是指流水线的深度，超导集成电路不能走金属线，只能靠物理器件直连，越靠前的流水线相关的器件需要优先摆放，因此需要基于器件的逻辑深度确定管脚的优先级；器件的逻辑深度越深，对应管脚的优先级越高。

更具体地，将各管脚对应的时序裕量从小到大排序，时序裕量小于第一预设值则判定为优先级高；将各器件的逻辑深度由深到浅排序，器件逻辑深度大于第二预设值则判定对应管脚的优先级高。其中，第一预设值及第二预设值可基于实际电路情况进行设定，在此不一一赘述。

需要说明的是，也可根据具体情况结合各管脚的时序信息及器件的逻辑深度进行优先级的确定，包括但不限于同时考虑时序裕量与逻辑深度，当时序裕量满足设定条件且逻辑深度满足设定条件时判定优先级高，在此不一一赘述，不以本实施例为限。

步骤S4：基于所述初始布局结果利用最小通道密度算法检查可布线性，若存在不可布线的通道，则利用器件多种管脚分布位置优化可布线性，再将挡住布线的相关器件移开，留出足够的布线空间；否则直接执行步骤5)。

具体地，采用最小通道密度算法检查可布线性，所述最小通道密度算法包括：将整个芯片所有布线通道划分为单元阵列，按照布局情况预估所有可能走线，保证预估布线经过的所有通道，其布线密度之和最小。此时可通过所述最小通道密度算法得到布线情况，若通道上存在器件或空间不足，则将挡住布线的器件移开，留出足够的布线空间；否则直接执行下一步。

作为本发明的另一种实现方式，在将挡住布线的器件移开之前，还包括利用超导集成电路的标准单元大都有多种管脚分布的特性，调整管脚分布位置，以此优化可布线性。

步骤S5：利用布线空间进行预估走线。

具体地，基于步骤S4的布线结果采用约瑟夫森传输线(JTL)或有源分支元件(Splitter) 进行走线，完成布线。

综上所述，本发明提供一种超导集成电路的布局方法，所述超导集成电路的布局方法至少包括：基于标准单元库建立以器件管脚为数据主体的数据库，所述数据库包括时序及物理信息；基于所述数据库进行静态时序分析，得到每个管脚的时序信息；基于各管脚的时序信息及器件的逻辑深度确定各管脚的优先级，对优先级高的管脚进行直连，以构造初始布局结果；基于所述初始布局结果利用最小通道密度算法检查可布线性，若存在不可布线的通道，将挡住布线的器件移开，留出足够的布线空间；否则直接执行下一步；利用布线空间进行预估走线。本发明的超导集成电路的布局方法实现了基于版图的静态时序分析算法，继而利用时序分析结果，考虑电路本身多种物理属性，完成自动布局，节省设计面积，同时布局结果无需额外走线资源。所以，本发明有效克服了现有技术中的种种缺点而具高度产业利用价值。

上述实施例仅例示性说明本发明的原理及其功效，而非用于限制本发明。任何熟悉此技术的人士皆可在不违背本发明的精神及范畴下，对上述实施例进行修饰或改变。因此，举凡所属技术领域中具有通常知识者在未脱离本发明所揭示的精神与技术思想下所完成的一切等效修饰或改变，仍应由本发明的权利要求所涵盖。