阅读说明：本技术 一种闪存及其制备方法 (Flash memory and preparation method thereof ) 是由 刘宪周 于 2019-09-26 设计创作，主要内容包括：本发明提供了一种闪存及其制造方法,所述闪存的制造方法包括以下步骤：提供一半导体衬底,半导体衬底包括相邻的单元区和高电阻多晶硅区,在单元区和高电阻多晶硅区的半导体衬底上均形成有字线结构；对字线结构进行P型离子注入；形成图形化的掩模层,掩模层覆盖了高电阻多晶硅区,并暴露出单元区的字线结构；以图形化的掩模层为掩模,对单元区的字线结构进行N型离子注入,并清除掩模层,以形成闪存。本发明通过在高电阻多晶硅区形成字线结构,使得无需增加掩模板的情况下,可以利用现有的掩模板制备的电阻多晶硅,其降低了生产成本；还通过上述步骤在高电阻多晶硅区形成了表面电阻高,温度系数低的字线结构。(The invention provides a flash memory and a manufacturing method thereof, wherein the manufacturing method of the flash memory comprises the following steps: providing a semiconductor substrate, wherein the semiconductor substrate comprises a unit area and a high-resistance polysilicon area which are adjacent, and word line structures are formed on the semiconductor substrate of the unit area and the high-resistance polysilicon area; performing P-type ion implantation on the word line structure; forming a patterned mask layer, wherein the mask layer covers the high-resistance polysilicon region and exposes the word line structure of the unit region; and taking the patterned mask layer as a mask, carrying out N-type ion implantation on the word line structure of the unit area, and removing the mask layer to form the flash memory. According to the invention, the word line structure is formed in the high-resistance polycrystalline silicon region, so that the resistance polycrystalline silicon prepared by the existing mask plate can be utilized without increasing the mask plate, and the production cost is reduced; and forming a word line structure with high surface resistance and low temperature coefficient on the high-resistance polysilicon region through the steps.)

一种闪存及其制备方法

技术领域

本发明涉及半导体制造领域，特别涉及一种闪存及其制备方法。

背景技术

闪存以其便捷，存储密度高，可靠性好等优点成为非挥发性存储器中研究的热点。从二十世纪八十年代第一个闪存产品问世以来，随着技术的发展和各类电子产品对存储的需求，闪存被广泛用于手机，笔记本，掌上电脑和U盘等移动和通讯设备中。闪存为一种非易失性存储器，其运作原理是通过改变晶体管或存储单元的临界电压来控制门极通道的开关以达到存储数据的目的，使存储在存储器中的数据不会因电源中断而消失，而闪存为电可擦除且可编程的只读存储器的一种特殊结构。如今闪存己经占据了非挥发性半导体存储器的大部分市场份额，成为发展最快的非挥发性半导体存储器。

一般而言，位于闪存高电阻区的多晶硅栅极存在多晶硅栅极表面的电阻低，温度系数高等问题，其无法满足闪存***电路的设计需求。

发明内容

本发明的目的在于提供一种闪存及其制备方法，以提高高电阻多晶硅区的字线结构表面的电阻，并降低其温度系数，以满足闪存***电路的设计需求。

为解决上述技术问题，本发明提供一种闪存的制备方法，包括以下步骤：

提供一半导体衬底，所述半导体衬底包括相邻的单元区和高电阻多晶硅区，在所述单元区和高电阻多晶硅区的半导体衬底上均形成有字线结构；

对所述单元区和高电阻多晶硅区的字线结构进行P型离子注入；

在所述单元区和高电阻多晶硅区形成图形化的掩模层，所述掩模层覆盖了所述高电阻多晶硅区，并暴露出所述单元区的字线结构；以及

以图形化的所述掩模层为掩模，对所述单元区的字线结构进行N型离子注入，并清除所述掩模层，以形成闪存。

可选的，所述字线结构包括依次形成于所述半导体衬底上的耦合氧化层、浮栅、控制栅、字线、保护层和第一氧化层，所述字线嵌设在所述浮栅和控制栅中，所述保护层包裹所述字线，且所述保护层位于所述控制栅上，所述第一氧化层覆盖了所述字线的上表面。

进一步的，所述P型离子注入中的离子为P型掺杂离子，所述P型掺杂离子包括硼离子、氟化硼离子、镓离子和铟离子中的至少一种。

进一步的，所述P型离子注入的剂量为5E¹³/cm²-1.5E¹⁴/cm²，所述P型离子注入时的入射角度为与所述衬底的表面的夹角为89°-91°，能量为 5Kev-15Kev。

进一步的，对所述单元区和高电阻多晶硅区的字线结构进行P型离子注入，与在所述单元区和高电阻多晶硅区形成图形化的掩模层，所述掩模层覆盖了所述高电阻多晶硅区，并暴露出所述单元区的字线结构之间还包括：

在所述第一氧化层上依次形成第一氮化层、第二氧化层和图形化的第一光刻胶层，其中，图形化的所述第一光刻胶层覆盖了所述单元区的字线结构，并在所述高电阻多晶硅区的字线结构上方具有第一开口；

以图形化的所述第一光刻胶层为掩模，刻蚀所述第一开口处的第一氮化层和第二氧化层，并暴露出所述开口处下方的第一氧化层，以形成逻辑阱；以及

清除剩余的所述第一光刻胶层、第二氧化层和第一氮化层。

进一步的，在所述单元区和高电阻多晶硅区形成图形化的掩模层，所述掩模层覆盖了所述高电阻多晶硅区，并暴露出所述单元区的字线结构包括以下步骤：

在所述高电阻多晶硅区的字线结构上形成多晶硅层和图形化的第二光刻胶层，所述第二光刻胶层覆盖了所述高电阻多晶硅区，并在所述单元区的字线结构上方具有第二开口；以及

以图形化的所述第二光刻胶层为掩模，刻蚀所述第二开口处的多晶硅层，并刻蚀停止在所述第一氧化层上，以形成图形化的多晶硅层。

进一步的，所述N型离子注入中注入的离子为N型掺杂离子，所述N 型掺杂离子包括磷离子、砷离子和锑离子中的至少一种。

进一步的，所述N型离子注入的剂量为1E¹⁵/cm²-10E¹⁵/cm²，所述N型离子注入时的入射角度为与所述衬底的表面的夹角为89°-91°，能量为 15Kev-30Kev。

本发明还提供了一种闪存，包括半导体衬底，所述半导体衬底包括单元区和高电阻多晶硅区，在所述单元区形成有具有N型重掺杂的字线结构，在所述高电阻多晶硅区形成有具有P型轻掺杂的字线结构。

可选的，所述P型轻掺杂的离子包括硼离子、氟化硼离子、镓离子和铟离子中的至少一种。

与现有技术相比存在以下有益效果：

本发明提供了一种闪存及其制造方法，所述闪存的制造方法包括以下步骤：提供一半导体衬底，所述半导体衬底包括相邻的单元区和高电阻多晶硅区，在所述单元区和高电阻多晶硅区的半导体衬底上均形成有字线结构；对所述单元区和高电阻多晶硅区的字线结构进行P型离子注入；在所述单元区和高电阻多晶硅区形成图形化的掩模层，所述掩模层覆盖了所述高电阻多晶硅区，并暴露出所述单元区的字线结构；以及以图形化的所述掩模层为掩模，对所述单元区的字线结构进行N型离子注入，并清除所述掩模层，以形成闪存。本发明通过在高电阻多晶硅区形成字线结构，使得无需增加掩模板的情况下，可以利用现有的掩模板制备高电阻多晶硅区的电阻多晶硅，其降低了生产成本。同时，还通过上述步骤在在高电阻多晶硅区形成了表面电阻高，温度系数低的字线结构，从而满足了闪存的***电路的设计需求。

附图说明

图1为一种典型的闪存的结构示意图；

图2为本发明一实施例的闪存的制备方法的流程示意图；

图3a-3e本发明一实施例的闪存在各步骤中的结构示意图；

附图标记说明：

图1中：

I-单元区；II-逻辑区；

10-半导体衬底；11-耦合氧化层；12-浮栅；13-控制栅；14-字线；20- 高电阻多晶硅栅极；

图3a-3e中：

I-单元区；II-高电阻多晶硅区；

100-半导体衬底；110、120-字线结构；111-耦合氧化层；112-浮栅；113- 控制栅；114-字线；115-保护层；116-第一氧化层；

210-第一氮化层；220-第二氧化层；230-第一光刻胶层；

300-掩模层；310-多晶硅层；320-第二光刻胶层。

具体实施方式

图1为一种典型的闪存的结构示意图。如图1所示，现有技术中一种典型的闪存的制造过程包括：

步骤S11：提供一半导体衬底10，所述半导体衬底10包括单元区I和高电阻多晶硅区II，在所述单元区I中，在所述半导体衬底10上形成有字线结构，在所述高电阻多晶硅区II中，在所述半导体衬底10上形成有高电阻多晶硅栅极20；其中，所述字线结构包括依次形成于所述半导体衬底10 上的耦合氧化层11、浮栅12、控制栅13和字线14，所述字线14嵌设在所述浮栅12和控制栅13中，所述字线14位于所述耦合氧化层11上，所述耦合氧化层11还形成于所述高电阻多晶硅栅极20与所述半导体衬底10之间；并通过CMP(化学机械平坦化或化学机械抛光)工艺对所述字线14 表面进行平坦化处理。

步骤S12：对所述字线14进行N型离子注入，注入剂量为 1E¹⁵/cm²-10E¹⁵/cm²，注入角度为xx，能量为15Kev-30Kev，，以形成闪存。

发明人研究发现，在步骤S11中，逻辑区中半导体衬底上形成的结构(高电阻多晶硅栅极)与单元区中半导体衬底上形成的字线结构不同，使得二者所使用的掩模板不同，造成工艺成本较高。另外，根据上述工艺制备得到的闪存的高电阻多晶硅栅极表面电阻低，温度系数高，其无法满足闪存***电路的设计需求。

基于上述研究，本发明提供了一种闪存及其制造方法，所述闪存的制造方法包括以下步骤：提供一半导体衬底，所述半导体衬底包括相邻的单元区和高电阻多晶硅区，在所述单元区和高电阻多晶硅区的半导体衬底上均形成有字线结构；对所述单元区和高电阻多晶硅区的字线结构进行P型离子注入；在所述单元区和高电阻多晶硅区形成图形化的掩模层，所述掩模层覆盖了所述高电阻多晶硅区，并暴露出所述单元区的字线结构；以及以图形化的所述掩模层为掩模，对所述单元区的字线结构进行N型离子注入，并清除所述掩模层，以形成闪存。本发明通过在高电阻多晶硅区形成字线结构，使得无需增加掩模板的情况下，可以利用现有的掩模板制备高电阻多晶硅区的电阻多晶硅，其降低了生产成本。同时，还通过上述步骤在高电阻多晶硅区形成了表面电阻高，温度系数低的字线结构，从而满足了闪存的***电路的设计需求。

以下将对本发明的一种闪存及其制备方法作进一步的详细描述。下面将参照附图对本发明进行更详细的描述，其中表示了本发明的优选实施例，应该理解本领域技术人员可以修改在此描述的本发明而仍然实现本发明的有利效果。因此，下列描述应当被理解为对于本领域技术人员的广泛知道，而并不作为对本发明的限制。

为了清楚，不描述实际实施例的全部特征。在下列描述中，不详细描述公知的功能和结构，因为它们会使本发明由于不必要的细节而混乱。应当认为在任何实际实施例的开发中，必须做出大量实施细节以实现开发者的特定目标，例如按照有关系统或有关商业的限制，由一个实施例改变为另一个实施例。另外，应当认为这种开发工作可能是复杂和耗费时间的，但是对于本领域技术人员来说仅仅是常规工作。

为使本发明的目的、特征更明显易懂，下面结合附图对本发明的具体实施方式作进一步的说明。需说明的是，附图均采用非常简化的形式且均使用非精准的比率，仅用以方便、明晰地辅助说明本发明实施例的目的。

图2为本实施例的闪存的制备方法的流程示意图。如图2所示，本实施例提供了一种闪存的制备方法，包括以下步骤：

步骤S21：提供一半导体衬底，所述半导体衬底包括相邻的单元区和高电阻多晶硅区，在所述单元区和高电阻多晶硅区的半导体衬底上均形成有字线结构；

步骤S22：对所述单元区和高电阻多晶硅区的字线结构进行P型离子注入；

步骤S23：在所述单元区和高电阻多晶硅区形成图形化的掩模层，所述掩模层覆盖了所述高电阻多晶硅区，并暴露出所述单元区的字线结构；以及

步骤S24：以图形化的所述掩模层为掩模，对所述单元区的字线结构进行N型离子注入，并清除所述掩模层，以形成闪存。

下面结合图2-3e对本实施例所公开的一种分栅快闪存储器的制备方法进行更详细的介绍。

如图3a所示，首先执行步骤S21，提供一半导体衬底100，所述半导体衬底100包括相邻的单元区I和高电阻多晶硅(High resistance，HR)区 II，在所述单元区I和HR区II的半导体衬底100上形成有字线结构110、 120，其中，所述字线结构110位于所述单元区I，所述字线结构120位于所述HR区II。可知，本实施例中位于所述HR区形成了和单元区I结构相同的字线结构来替代现有的高电阻多晶硅栅极，使得单元区I和HR区II 中的结构不仅可以同时形成，还节省了专门形成HR区II高电阻多晶硅栅极的掩模板，降低了生产成本。

需要说明的是，为了便于理解，本实施例中仅示出了所述单元区I中的一个字线结构110，以及HR区II中的一个字线结构120，但是实际上在单元区I中的字线结构110，以及HR区II中的字线结构120均不只一个。

具体的，首先，提供一半导体衬底100，所述半导体衬底100可为后续工艺提供操作平台，其可以是本领域技术人员熟知的任何用以承载半导体集成电路组成元件的底材，可以是裸片，也可以是经过外延生长工艺处理后的晶圆，详细的，所述半导体衬底100例如是绝缘体上硅(silicon-on-insulator，SOI)基底、体硅(bulk silicon)基底、锗基底、锗硅基底、磷化铟(InP)基底、砷化镓(GaAs)基底或者绝缘体上锗基底等。所述字线结构110、120例如是包括形成于所述半导体衬底100上的耦合氧化层111，浮栅112，控制栅113，嵌设在所述浮栅112和控制栅113中的字线114，以及包裹所述字线114的保护层115，所述保护层115位于所述控制栅113上，所述保护层115的材料例如是氧化物，其包裹了所述字线114 的侧壁。所述耦合氧化层111的材料包括但不限于二氧化硅，优选的为二氧化硅，有利于增加层与层之间的界面粘附性，所述耦合氧化层111用于隔离所述半导体衬底100和浮栅112，其厚度可以根据具体的工艺需求进行变换，所述浮栅112能够俘获或失去电子，从而能够使最终形成的闪存具有存储以及擦除的功能，其厚度可以根据工艺需求而定。

接着，在所述单元区I和高电阻多晶硅区II的所述字线结构110、120 上还形成了第一氧化层116，具体的例如是采用化学气相沉积工艺或物理气相沉积工艺等在所述单元区I和高电阻多晶硅区II的所述字线结构110、120 上形成第一氧化层116，所述第一氧化层116覆盖了所述字线114的上表面；再采用CMP工艺对所述第一氧化层116进行平坦化处理。其中，所述第一氧化层116有利于防止后续离子注入工艺对所述字线114的损伤。所述第一氧化层116的材料例如是采用氧化硅，所述第一氧化层116的厚度例如是

如图3b所示，接着执行步骤S22，对所述单元区I和高电阻多晶硅区 II的字线结构110、120进行P型离子注入，以在高电阻多晶硅区形成了表面电阻高，温度系数低的字线结构，从而满足了闪存的***电路的设计需求。

具体的，在所述单元区I和高电阻多晶硅区II，从所述第一氧化层116 上方对所述字线结构110、120进行P型离子注入。

在本步骤中，所述P型离子注入中的离子为P型掺杂离子(即导电类型为P型的离子)，所述P型掺杂离子包括硼(B)离子、氟化硼(BF₂+) 离子、镓(Ga)离子和铟(In)离子中的至少一种，具体例如是硼离子。所述P型离子注入的剂量为5E¹³/cm²-1.5E¹⁴/cm²，所述P型离子注入时的入射角度为与所述衬底的表面的夹角为89°-91°，能量为5Kev-15Kev。

如图3c所示，接着，在所述第一氧化层116上依次形成第一氮化层210、第二氧化层220和图形化的第一光刻胶层230，例如是采用化学气相沉积工艺在所述第一氧化层116上依次形成第一氮化层210和第二氧化层220，所述第一氮化层210的材料例如是氮化硅，所述第一氮化层210的厚度例如是

所述第二氧化层220的材料例如是氧化硅，所述第二氧化层220的厚度例如是

图形化的所述第一光刻胶层230覆盖了所述单元区I的字线结构110，并在所述高电阻多晶硅区II的字线结构 120上方具有第一开口，其中，图形化的所述第一光刻胶层230的厚度例如是

接着，以图形化的所述第一光刻胶层230为掩模，刻蚀所述第一开口处的第一氮化层210和第二氧化层220，并暴露出所述开口处下方的第一氧化层116，以形成逻辑阱。此处，采用了现有工艺进行制备，因此，无需详细说明。在形成逻辑阱时仅在高电阻多晶硅区II进行了相关的工艺，因此减低了该工艺对单元区I的字线结构的影响。

接着，清除了剩余的所述第一光刻胶层230、第二氧化层220和第一氮化层210。

如图3d所示，接着执行步骤S23，在所述单元区I和高电阻多晶硅区 II形成图形化的掩模层300，所述掩模层300覆盖了所述高电阻多晶硅区 II，并暴露出所述单元区I的字线结构110。其中，所述掩模层300包括图形化的第二光刻胶层320和图形化的多晶硅层310。

本步骤具体包括：

如图3d所示，首先，在所述高电阻多晶硅区II的字线结构120上形成多晶硅层310和图形化的第二光刻胶层320，所述第二光刻胶层320覆盖了所述高电阻多晶硅区II，并在所述单元区I的字线结构110上方具有第二开口。

接着，以图形化的所述第二光刻胶层320为掩模，刻蚀所述第二开口处的多晶硅层310，并刻蚀停止在所述第一氧化层116上，以形成图形化的多晶硅层310。其中，所述多晶硅层310的厚度例如是

图形化的所述第二光刻胶层320的厚度例如是

如图3e所示，接着执行步骤S24，以图形化的所述掩模层300为掩模，对所述单元区I的字线结构110进行N型离子注入，并清除所述掩模层300，以形成闪存。本步骤的N型离子注入的对象为单元区I的字线结构110，而非现有技术中的电阻多晶硅区II的多晶硅栅极，其有利于降低温度系数。

具体的，首先，以图形化的所述第二光刻胶层320和图形化的所述多晶硅层310为掩模，对所述单元区I的字线结构110进行N型离子注入。

在本步骤中，所述N型离子注入中注入的离子为N型掺杂离子(即导电类型为N型的离子)，所述N型掺杂离子例如包括磷(P)离子、砷(As) 离子和锑(Sb)离子中的至少一种，具体例如是磷(P)离子。本步骤可以形成具有N型重掺杂的多晶硅栅极的字线。所述N型离子注入的剂量为 1E¹⁵/cm²-10E¹⁵/cm²，所述N型离子注入时的入射角度为与所述衬底的表面的夹角为89°-91°，能量为15Kev-30Kev。

接着，去除位于所述高电阻多晶硅区II的第二光刻胶层320和多晶硅层310。

接着，在所述高电阻多晶硅区II的所述字线结构120的侧壁上形成侧墙，以形成闪存。

请继续参阅图3e，本发明还提供一种闪存，所述闪存包括：半导体衬底100，所述半导体衬底100包括单元区I和高电阻多晶硅区II，在所述单元区I形成有字线结构110，在所述字线结构110具有N型重掺杂；在所述高电阻多晶硅区II形成有字线结构120，在所述字线结构120侧壁上形成有侧墙，所述字线结构120具有P型轻掺杂，该结构的高电阻多晶硅区表面电阻高，温度系数低的字线结构，从而满足了闪存的***电路的设计需求。

综上，本发明提供了一种闪存及其制造方法，所述闪存的制造方法包括以下步骤：提供一半导体衬底，所述半导体衬底包括相邻的单元区和高电阻多晶硅区，在所述单元区和高电阻多晶硅区的半导体衬底上均形成有字线结构；对所述单元区和高电阻多晶硅区的字线结构进行P型离子注入；在所述单元区和高电阻多晶硅区形成图形化的掩模层，所述掩模层覆盖了所述高电阻多晶硅区，并暴露出所述单元区的字线结构；以及以图形化的所述掩模层为掩模，对所述单元区的字线结构进行N型离子注入，并清除所述掩模层，以形成闪存。本发明通过在高电阻多晶硅区形成字线结构，使得无需增加掩模板的情况下，可以利用现有的掩模板制备高电阻多晶硅区的电阻多晶硅，其降低了生产成本。同时，还通过上述步骤在高电阻多晶硅区形成了表面电阻高，温度系数低的字线结构，从而满足了闪存的***电路的设计需求。

此外，需要说明的是，除非特别说明或者指出，否则说明书中的术语“第一”、“第二”的描述仅仅用于区分说明书中的各个组件、元素、步骤等，而不是用于表示各个组件、元素、步骤之间的逻辑关系或者顺序关系等。

可以理解的是，虽然本发明已以较佳实施例披露如上，然而上述实施例并非用以限定本发明。对于任何熟悉本领域的技术人员而言，在不脱离本发明技术方案范围情况下，都可利用上述揭示的技术内容对本发明技术方案作出许多可能的变动和修饰，或修改为等同变化的等效实施例。因此，凡是未脱离本发明技术方案的内容，依据本发明的技术实质对以上实施例所做的任何简单修改、等同变化及修饰，均仍属于本发明技术方案保护的范围内。